STM32F103电路引脚功能定义及部分参考电路设计

最新推荐文章于 2024-09-02 18:11:56 发布

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分类专栏：单元电路设计文章标签：嵌入式 stm32 接口

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STM32F103各引脚（LQFP64）功能定义

NOTE：

1.供电方案

●VDD = 2.0至3.6 V：用于I / O的外部电源和内部稳压器，通过VDD引脚从外部提供。

●VSSA，VDDA = 2.0至3.6 V：用于ADC，DAC，复位模块，RC和PLL（当ADC或DAC模块使用，施加到VDDA的最小电压为2.4 V）， VDDA和VSSA必须分别连接到VDD和VSS。

●VBAT = 1.8至3.6 V：当不存在VDD时，用于RTC，外部时钟32 kHz振荡器和备用寄存器（通过电源开关）。

从上图可知：

每个VDD各接一个100nF陶瓷电容，其中VDD3需要再接一个4.7uF的钽电容；

VDDA：接10nF陶瓷电容+1uF钽电容；

VREF+：可接VDDA，也可接外部参考源，此时也需要接10nF陶瓷电容+1uF钽电容；

2.通信接口

1.I2C总线

STM32F103提供两个I2C总线接口，作为从机时，支持7/10位寻址模式和7位双寻址模式，I2C总线配置可由DMA控制器提供服务。

2.SPI接口

在全双工和单工通信模式下，从机和主机模式下，提供三个SPI接口能够以18Mbit/s速率通信，所有SPI接口配置均可由DMA控制器提供服务。

3.I2S接口

I2S（Inter-IC Sound）是飞利浦公司针对数字音频设备（如CD播放器、数码音效处理器、数字电视音响系统）之间的音频数据传输而制定的一种总线标准。它采用了独立的导线传输时钟与数据信号的设计，通过将数据和时钟信号分离，避免了因时差诱发的失真，为用户节省了购买抵抗音频抖动的专业设备的费用。标准的I2S总线电缆是由3根串行导线组成的：1根是时分多路复用（简称TDM）数据线；1根是字选择线；1根是时钟线。

STM32F103提供两个I2S总线接口（与SPI2和SPI3复用），音频采样频率支持8KHz至48kHz。
I2S有3个主要信号：

1.串行时钟SCLK，也叫位时钟（BCLK），即对应数字音频的每一位数据，SCLK都有1个脉冲。SCLK的频率=2×采样频率×采样位数。

2. 帧时钟LRCK，(也称WS)，用于切换左右声道的数据。LRCK为“1”表示正在传输的是右声道的数据，为“0”则表示正在传输的是左声道的数据。LRCK的频率等于采样频率。

3.串行数据SDATA，就是用二进制补码表示的音频数据。

有时为了使系统间能够更好地同步，还需要另外传输一个信号MCLK，称为主时钟，也叫系统时钟（Sys Clock），是采样频率的256倍或384倍。

4.USART接口

STM32F103系列嵌入了三个通用同步/异步接收器发送器（USART1,USART2和USART3）和两个通用异步接收器发送器（UART4和UART5）。

USART1接口能够以高达4.5Mbit/s速率通信，其余可用接口通信速率最高为2.25Mbit/s，USART1，USART2和USART3还提供CTS和RTS信号的硬件管理。DMA控制器可以为所有接口提供服务，但UART5除外。

引脚功能定义：

TX:发送数据输出引脚。

RX:接收。

nRTS:请求以发送，n表示低电平有效。如果使能 RTS 流控制，当USART接收器准备好接收新数据时就会将nRTS变成低电平；当接收寄存器已满时，nRTS将被设置为高电平。该引脚只适用于硬件流控制。